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[讨论] $mc_mirror 或 hdl_xmr 的作用

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发表于 2020-9-14 23:49:41 | 显示全部楼层 |阅读模式

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最近看到这个用法的代码:


           xm_mirror (destination => "realx",            
               source      => "real1",         
               verbose     => "verbose");





但是我在自己的verilog demo试一试,
      reg  xm_aa ;
      $xm_mirror ("xm_aa", "/rtl/");


就会报错
      xmsim: *E,PNOVHD: No VHDL root in design: /rtl/.
      xmsim: *E,EMIRR: The above error is for XMMIRROR at File : ./top_tb.sv, line : 54 .
      xm_mirror, xm_aa = x


根据提示信息,他这是必须指向VHDL代码吗? 还有VHDL root是啥?类似于top?

发表于 2020-9-15 09:31:31 | 显示全部楼层
vhdl verilog层次 seperator不一样
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