在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
查看: 7595|回复: 9

[解决] UVM寄存器模型的后门访问路径设置

[复制链接]
发表于 2020-8-22 17:08:35 | 显示全部楼层 |阅读模式

马上注册,结交更多好友,享用更多功能,让你轻松玩转社区。

您需要 登录 才可以下载或查看,没有账号?注册

x
我搭建的寄存器模型对于前门访问能够正确操作;

要进行后门访问,在寄存器模型中了添加:reg.add_hdl_path_slice("spi_width_reg", 0, 32)和uvm_reg_block.add_hdl_path("top_tb");

但是在test_case中使用后门访问,一直会出现ERROR: unable to locate hdl path (*.spi_width_reg), Either the name is incorrect, or you may not have PLI/ACC visibility to that name。

检查了,路径设置正确啊。

大哥们救救弟弟吧:
发表于 2020-8-22 19:58:50 来自手机 | 显示全部楼层
说的很清楚啊,或者给的字符串名字不对,或者没开启权限。如果是前者,检查下路径,如果是后者,开启权限就行了,vcs的话用-debug_acc+pp,或者-PP,根据版本不同而定,最粗暴的-debug_all
 楼主| 发表于 2020-8-22 20:40:26 | 显示全部楼层


saipolo 发表于 2020-8-22 19:58
说的很清楚啊,或者给的字符串名字不对,或者没开启权限。如果是前者,检查下路径,如果是后者,开启权限就 ...


检查了下,路径和字符串名是对的。VCS命令-debug_acc+all。
 楼主| 发表于 2020-8-23 17:44:42 | 显示全部楼层
本帖最后由 chip_z 于 2020-8-23 18:12 编辑

已解决,
发表于 2020-8-24 19:28:00 | 显示全部楼层
估计是误写哈哈
发表于 2020-8-24 21:46:00 | 显示全部楼层


卤煮,啥问题呀?给讲解一下撒
 楼主| 发表于 2020-8-24 21:56:50 | 显示全部楼层


Hyan-1021 发表于 2020-8-24 21:46
卤煮,啥问题呀?给讲解一下撒


将reg_block.add_hdl_path("path")改为reg_clock.set_hdl_path_root("path")就好了。
也不知道为啥用add_hdl_path("")不对。
发表于 2020-8-25 16:58:54 | 显示全部楼层


chip_z 发表于 2020-8-24 21:56
将reg_block.add_hdl_path("path")改为reg_clock.set_hdl_path_root("path")就好了。
也不知道为啥用add_ ...


会不会是add_hdl_path的地址要写到tb.dut中的实例
发表于 2021-1-5 22:05:22 | 显示全部楼层


楼主,你好,请问那个hdl路径指的是哪个路径?我一直设置不正确
发表于 2023-8-24 21:37:36 | 显示全部楼层
顶一顶
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条

×

小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-11-14 12:14 , Processed in 0.022121 second(s), 6 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表