新手求助，FPGA综合后仿真的信号怎么看

finished · 发表于 2020-8-19 16:47:38

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用的verilog编码，前仿真都好着呢
综合后仿真不正确，想看看内部的信号
但是信号好像都被优化掉了，一个也找不着
怎么才能看到需要的信号呢
使用(*synthesis,probe_port,keep *)
和 /*synthesis syn_keep=1*/
也不管用，在仿真时还是找不到信号。

finished · 发表于 2020-8-19 17:22:13

不好意思，帖子不能删除，找了一下信号是在的，就是被打乱了

[求助] 新手求助，FPGA综合后仿真的信号怎么看