LVS ERROR

Eugen · 发表于 2020-8-8 20:49:33

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ERROR: Source could not be read
有谁知道吗？怎么解决呢？

amodaman · 发表于 2020-8-8 21:42:22

就是CDL网表没读到，没法比较CDL和Layout。

843071455 · 发表于 2020-8-9 15:27:46

你这个问题原因可能很多，如果确定网表没有用错，多数是线路的库和topcell没有填对，你可以是确认一下！

Eugen · 发表于 2020-8-9 16:09:59

843071455 发表于 2020-8-9 15:27
你这个问题原因可能很多，如果确定网表没有用错，多数是线路的库和topcell没有填对，你可以是确认一下！ ...

仔细检查过都是对的

LINGYZ · 发表于 2020-8-10 10:19:18

出现这个问题多半是因为你的电路原理图没有check and save，你可以试一下在电路图上方工具栏的check选择hierarchy然后三个选项都选第一个

sssnake1 · 发表于 2020-8-10 10:59:25

可以检查下网表电源地的定义有没有出错。

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