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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › ESD Robustness
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查看: 1715|回复: 2

[求助] ESD Robustness

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chenjirong
发表于 2020-6-30 20:33:56 | 显示全部楼层 |阅读模式

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winningzhong
发表于 2020-7-1 08:49:16 | 显示全部楼层
为什么不是选B？
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xuwenwei
发表于 2020-7-1 08:57:40 | 显示全部楼层
搜了一下，salicide：既能降低栅极电阻，又能降低源漏电阻，说明non salicide 提高电阻，那ESD肯定更好
layout 那个应该也可以的吧 这样就不会存在那些地方不同 导致电荷积聚 引起 esd吧
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