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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › About ECF early clock flow
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查看: 3422|回复: 1

[解决] About ECF early clock flow

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发表于 2020-2-29 10:47:05 | 显示全部楼层 |阅读模式

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    各位老板，在使用early clock flow 时候，tree 上某些cell出现很大的 负值delay ，
   launch tree latency 是 0 ， 但是 capture tree 上总的latency 是很大的负值 ，请问这个是怎么回事啊？
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八月飘雪66
发表于 2021-10-15 23:32:34 | 显示全部楼层
因为是clock gate
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