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[求助] cadence lvs source could not be read

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发表于 2019-11-28 20:53:37 | 显示全部楼层 |阅读模式

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`_N~IB~{[0UV29NE6~.jpg 在进行lvs时,由于种种原因,不能自动提取网表,所以手动提取,之前没问题,但现在会报错,说网表的第十九行存在语法错误,就是第一张图,,第二张图进行lvs没问题,就是多了一个v=,想请教一下各位大哥,,怎么解决,,很急!!!
 楼主| 发表于 2019-11-28 22:12:26 | 显示全部楼层
别沉啊,,来个大哥帮帮我啊,,
发表于 2019-11-29 09:35:31 | 显示全部楼层
我的话就直接删掉v=,有时候连.PARAM都不要
发表于 2019-11-29 09:43:46 | 显示全部楼层
这是参数声明的吧 ,.param 后面要加东西的话要这样子的格式  .param vdd=1.5v  .param Ix=1uA
发表于 2019-12-3 19:54:15 | 显示全部楼层
你这个是没定义端口?没有source.add 这个网表?
 楼主| 发表于 2019-12-4 12:45:15 | 显示全部楼层


石头遇见雪 发表于 2019-12-3 19:54
你这个是没定义端口?没有source.add 这个网表?


额,,是模拟ic,,我不是很懂,,定义什么端口。。怎么定义啊
发表于 2019-12-10 15:08:03 | 显示全部楼层
什么什么两个网表的top cell name 不一致?
发表于 2022-4-7 14:12:31 | 显示全部楼层
我也遇到了这个问题,具体原因不是很清楚。新建一个空白的电路图和版图,在电路图和版图里面copy  分别copy到新的就解决了
发表于 2024-8-27 10:17:11 来自手机 | 显示全部楼层


小小象 发表于 2022-4-7 14:12
我也遇到了这个问题,具体原因不是很清楚。新建一个空白的电路图和版图,在电路图和版图里面copy  分别copy ...


感谢 解决了
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