Veriloga extract falied

chuchu0701 · 发表于 2019-11-19 10:42:12

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使用cadence virtuoso veriloga 建立一個測試程式碼轉出SYMBOL 結果有錯誤
Veriloga extract falied (te-4309): extract failed for cellview
幫忙求解~~

老尤皮 · 发表于 2019-11-19 10:57:31

第8行写错了，n写成了nn

chuchu0701 · 发表于 2019-11-19 13:50:26

老尤皮发表于 2019-11-19 10:57
第8行写错了，n写成了nn

已更改還是一樣

远上寒杉 · 发表于 2019-11-20 11:23:49

点 view -> log file，看一下提示。

chuchu0701 · 发表于 2019-11-20 13:56:36

远上寒杉发表于 2019-11-20 11:23
点 view -> log file，看一下提示。

已看都是空的才無解~~~

dahai_xiao · 发表于 2020-8-14 16:06:20

关掉软件，重启下服务器就行了

newrfdesign · 发表于 2020-8-20 10:31:47

Thanks for sharing

andyseu · 发表于 2021-1-13 22:35:08

楼主请问你问题解决了吗？我也遇到同样的问题

chuchu0701 · 发表于 2021-1-14 10:18:53

andyseu 发表于 2021-1-13 22:35
楼主请问你问题解决了吗？我也遇到同样的问题

解決搂謝謝

wild-mountain · 发表于 2021-2-20 13:22:07

应该是把两行 parameter放大module之外

[求助] Veriloga extract falied