|
马上注册,结交更多好友,享用更多功能,让你轻松玩转社区。
您需要 登录 才可以下载或查看,没有账号?注册
x
請問大神, 我在用 vcs-xa 做混合仿真, 只有產生出一個 fsdb(應該有一個數字的 fsdb 和模擬的 fsdb ?)
並且這個 fsdb 用 nwave 開或是用 waveview 都無法看到底層電路的節點, 只看得到 top 層,
我的環境是 spice_top(testbench) , top 底下 instance 一個 verilog module 和 一個 spice module
. cfg 內容是
set_sim_case -case lower
probe_waveform_logic * -limit 10
probe_waveform_voltage * -limit 10
set_sim_level 4
|
|