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楼主: qinyuc

[求助] 新手，学习verilog还是直接上system verilog

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chendiyi
发表于 2020-5-15 13:51:13 | 显示全部楼层
先学Verilog，再学SV，设计用SV会更简洁，不过需要注意哪些子集是可综合的。可以关注一下微信公众号 数字芯片作坊记 有一篇文章做了总结
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