pipline ADC 为什么一般不用两级运放？

tangyaoyun · 发表于 2019-5-13 22:38:59

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如题，看过很多pipline的设计，都是用的增益提升技术，没见过两级的运放，是因为负载电容比较大怕相位裕度不够吗？求解释

ericking0 · 发表于 2019-5-14 22:51:04

我猜的，单级速度更快，功耗更低，面积更小；唯一的输出摆幅小的问题都是可以客服的。

wkp1992101 · 发表于 2019-5-24 16:25:57

Vos的问题吧，前级的Vos会被后级放大吧，我猜的

侯门似海 · 发表于 2019-5-25 11:08:13

也有用两级的呀

luker95 · 发表于 2019-5-25 16:21:38

两级运放的SR会拖后腿，指望1ns以内建立是肯定要牺牲增益的（增大第一级的电流），结果功耗炸裂。

kayd · 发表于 2019-5-26 23:51:00

单级结构输出swing是个问题啊

[求助] pipline ADC 为什么一般不用两级运放？