pll仿真division时的vpulse是如何设置啊

tjh5257 · 发表于 2019-3-5 15:55:16

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请问pll仿真division时的vpulse是如何设置啊，我正常设置是总是报：V1（vpulse实例名）is a periodic input signal，which is inconsistent with autonomous circuits；错误。V1正常设置了周期，延时，上升下降时间，脉宽，和frequency name for 1/period填写了一个名称。

tjh5257 · 发表于 2019-3-5 16:18:04

是pll的divider，写错了。

prince-guido · 发表于 2020-1-11 09:25:29

我也碰到这个问题了，请问怎么解决的

[求助] pll仿真division时的vpulse是如何设置啊

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