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[原创] CMOS模拟集成电路版图设计与验证-基于Cadence Virtuoso与Mentor Calibre

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发表于 2019-1-15 12:21:47 | 显示全部楼层 |阅读模式

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CMOS模拟集成电路版图设计与验证-基于Cadence Virtuoso与Mentor Calibre【电子工业出版社201609】尹飞飞

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发表于 2019-1-15 15:06:41 | 显示全部楼层
A good company with my print copy
发表于 2019-1-15 16:59:18 | 显示全部楼层
回复 1# xuleiwx


   好人一生平安
发表于 2019-1-15 17:06:57 | 显示全部楼层
路过。。。。
发表于 2019-1-15 19:36:17 | 显示全部楼层
Thanks a lot
发表于 2019-1-15 22:15:31 | 显示全部楼层
谢谢分享
发表于 2019-1-15 22:22:39 | 显示全部楼层
多谢分享
发表于 2019-1-15 23:39:48 | 显示全部楼层
Thanks
发表于 2019-1-16 17:35:28 | 显示全部楼层
kan kan.................
发表于 2019-1-16 17:36:31 | 显示全部楼层
kan kan..................
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