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查看: 6706|回复: 9

[讨论] 高速高精度ADC的input buffer设计

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发表于 2018-12-14 10:40:19 | 显示全部楼层 |阅读模式

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如下图所示,是目前高速ADC常用的input buffer,一般采用高压供电的source follower,这种结构应该目前高速性能最好的,想和大家探讨一下如何再继续提升input buffer的高频性能
(输入信号超过GHz)
,目前看paper上已经TI的产片上,1.8G输入信号时的SFDR<68dB,qq群(372637819)
1544755207(1).png
发表于 2018-12-14 21:43:14 | 显示全部楼层
可以发下论文的名字吗?
发表于 2019-5-23 14:30:31 | 显示全部楼层
buffer的带宽是怎么考虑的呢?与采样率之前的关系?楼主方便说一下是怎么考虑的吗?
发表于 2019-9-19 14:30:16 | 显示全部楼层
thnak
发表于 2020-3-23 09:33:22 | 显示全部楼层
你好,我想问下,像这种input buffer开始是怎么着手设计的?我刚进入,现在在学习设计
发表于 2020-8-4 11:19:12 | 显示全部楼层


gm-cfiltersz 发表于 2018-12-14 21:43
可以发下论文的名字吗?


An input buffer for 12bit 2GS/sADC

发表于 2020-9-24 14:52:35 | 显示全部楼层
这个buffer的输入等效电容很大,楼主如何解决的呢
发表于 2022-4-14 19:55:21 | 显示全部楼层
hao dong dong
发表于 2023-12-12 21:46:20 | 显示全部楼层


梦飘远方 发表于 2020-9-24 14:52
这个buffer的输入等效电容很大,楼主如何解决的呢


解决了吗,这个input buffer还能改进吗
发表于 2024-8-30 11:42:17 | 显示全部楼层
这个结构还是不太行
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