计数器能用作分频器吗

羽扇轻摇 · 发表于 2018-12-5 23:07:57

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一个free counter的bit0 的波形时一个2分频的clock其可以直接拿来做时钟用驱动后面的逻辑吗？
还是把它接到 Clock gating cell （ICG）的enable端，与主时钟AND之后产生时钟？

这两种的区别在哪里？应该采用哪种方式？

谁枫而飘 · 发表于 2018-12-6 08:25:04

一般不能，因为这样产生的始终，驱动能力弱。我曾经这样做过，后面的逻辑完全乱了，可以把分频过后的时钟经过一个时钟buffer再去驱动就可以了

2cky · 发表于 2018-12-6 11:18:06

驱动是个比较大的问题。

my2817 · 发表于 2018-12-6 21:48:30

什么不】能这么做？驱动，那不是后端要考虑的吗?ICG，这个就看设计需求吧

羽扇轻摇 · 发表于 2018-12-6 23:03:42

正如楼上所说，关于驱动问题，CTS时可以插clock buffer。对于前端来讲，这貌似并不是问题。
那么对于1楼所说的两种写法，
直接拿Q端做时钟，和将其作为Enable端与clock做Gating
究竟有没有孰优孰劣之分？

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