请教Level-shift的设计

pasher · 发表于 2007-9-29 11:13:16

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..                         --- VDD
                           |
                  ----------------
                  |             |
               P0 --          --  P1
                  <-- ||--- --||-->
                  --    \ / --
                  |       /    |
                  |    / \    |
            C----|------- ------|-----D
                  |             |
                  |             |
               N0 --          N1 --
                  ->||--A       ->||--B
                  --             --
                  |             |
                  |             |
                  ----------------
                           |
                           --- VSS

输入为A,B, 输出为C,D. A电压值为0～X1, B=!A, VDD > A, 请教电路中P0,P1,N0,N1的W/L的设计,和Level-shift工作原理,以及A和VDD之间的
压差要满足什么条件呢?

[ 本帖最后由 pasher 于 2007-9-29 11:16 编辑 ]

xiny06707 · 发表于 2007-11-15 16:59:02

上面的电路中，pmos的w/l要小于nmos的，out的电位由gnd～vdd

joe_chen · 发表于 2008-3-3 17:29:15

能更详细解释？

sxb416 · 发表于 2009-6-8 17:00:37

It is easy to design!!!!

dylan_uestc · 发表于 2012-11-8 18:26:20

低到高的的levelshift，一般把NMOS做强~

神般存在 · 发表于 2016-5-12 16:51:06

回复 5# dylan_uestc

能详细解释一下吗

请教Level-shift的设计

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