如何约束这种情况下的寄存器到寄存器之间的路径

Cccyz · 发表于 2025-8-17 00:14:26

请问解决问题了吗？

xhopo · 发表于 2025-8-25 13:28:32

R->R1->R2，分别设置R-R1和R1->R2的max_delay试试呢

xhopo · 发表于 2025-8-25 13:30:17

xhopo 发表于 2025-8-25 13:28
R->R1->R2，分别设置R-R1和R1->R2的max_delay试试呢

如果实在满足不了，是否可以考虑这里做CDC改成异步时序

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