请问如何提高modelsim的仿真速度

sunhui_asic · 发表于 2018-6-22 14:49:54

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本帖最后由 sunhui_asic 于 2018-6-22 14:52 编辑

请问哪位知道比较全面的介绍如何提高modelsim仿真速度的资料？我这里仿真时，代码比较多，且是vhdl代码，有xilinx的一些ipcore，然后顶层tb设置timescale为1ns/10ps，内部绝大多数模块时钟频率是200MHz，我这里仿真时跑了快15个小时了，总共才跑了5ms，感觉不应该，群里大牛们给点建议吧！谢谢

秋天叶子落 · 发表于 2018-6-22 16:46:30

仿真的话，时钟可以改成慢一些的

student321 · 发表于 2018-6-22 19:51:30

事件决定的，除了并行快不了

sunhui_asic · 发表于 2018-6-22 21:50:14

回复 3# student321

你好，你指的并行是什么意思？

lx2116 · 发表于 2018-6-23 13:15:03

用VCS应该能比modelsim快

dcircuit · 发表于 2018-6-23 17:32:39

回复 4# sunhui_asic

并行仿真工具

Desingman · 发表于 2018-6-24 18:40:57

事件决定的，除了并行快不了

吾要单片机 · 发表于 2018-6-24 20:33:51

是什么项目啊？仿真都要花那么长时间。

rosshardware · 发表于 2018-6-25 11:15:52

5ms也算是仿真时间比较长的仿真了，一般EDA 仿真，一个用力也就是跑个几百us，长时间的仿真都考虑在EDA上把时间门限缩短，比如本来一帧是1ms,缩短为1us进行仿真，然后上FPGA进行1ms的真是场景仿真。你如果提升时钟工作频率进行仿真，或许能够提高一些速度，但是也不会有本质改变，长时间仿真用例需要通过FPGA来完成

sunhui_asic · 发表于 2018-6-26 14:49:03

回复 9# rosshardware

需要仿真单张图片，和算法做数据比对。单张图片比较特殊，比较大（4k分辨率）。又调用了xilinx的一些fifo-ip，跑起来真的是很慢。

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