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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › [讨论]viterbi译码器的实现
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楼主: 清河

[讨论]viterbi译码器的实现

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loco
发表于 2007-1-25 18:51:44 | 显示全部楼层
FPGA应该快些
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wzqaxue
发表于 2007-2-3 15:02:18 | 显示全部楼层
什么也看不到
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发表于 2007-3-16 11:01:25 | 显示全部楼层
谢谢了，正需要
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发表于 2007-3-19 13:33:11 | 显示全部楼层
不错，先看看
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发表于 2007-3-25 11:45:10 | 显示全部楼层
是啊，狠狠的挖 ！哈哈
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发表于 2007-3-25 21:38:58 | 显示全部楼层
我的毕业设计是Turbo译码， 也要用到Viterbi算法， 现在算法都还没有搞懂， 痛苦啊
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晓树
发表于 2007-4-4 10:54:11 | 显示全部楼层
怎么交流突然停止了
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lling65
发表于 2007-4-4 14:46:21 | 显示全部楼层
很有用的东西
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lemelody
发表于 2007-4-10 20:21:16 | 显示全部楼层
我下了,好好看
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晓树
发表于 2007-4-16 22:42:58 | 显示全部楼层
看看什么东西
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