求助帖：半带fir滤波器

xumt · 发表于 2018-5-3 18:58:18

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有大神用verilog设计过半带fir抽取滤波器吗？小白求问设计思路

superhorsemmc · 发表于 2018-5-4 08:47:24

fir滤波器会吗？

zhou19891227 · 发表于 2018-5-5 10:31:05

按照设计FIR的思路去做就行，不过截至频率一般在fs/4左右，通带看信号要求，matlab生成系数，然后量化为定点系数，导入到 FIR IP里就行

xumt · 发表于 2018-5-7 10:53:01

回复 2# superhorsemmc

fir不会呀

xumt · 发表于 2018-5-7 10:54:04

回复 3# zhou19891227

fir不会做，而且如果要自己写不调用IP核怎么做

zhou19891227 · 发表于 2018-5-7 14:20:41

回复 5# xumt

使用matlab 的fdatool工具生成滤波器系数，包括阶数，衰减，截止带，通带，等，将生成的系数导出来，在matlab中转成定点，至于在FPGA中是不是自己写，感觉不重要，调IP核更方便些，自己写也要区分是不是流水结构，总之就是信号跟这些系数的乘加运算

xumt · 发表于 2018-5-8 08:46:47

回复 6# zhou19891227

谢谢

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