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[讨论] Xilinx家FPGA软件使用流程优化

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发表于 2018-2-5 16:02:11 | 显示全部楼层 |阅读模式

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X家的vivado开始对TCL的支持变得好了,但是一直以来不怎么会用全命令行模式,最近玩ZYNQ,发现要用block diagram进行设计,更不得不使用gui。。。有老司机来分享一下X家软件的tips吗,能不能像S/M/C家的软件那样做出模板脚本,省得开gui碍眼还影响效率
发表于 2018-2-5 19:44:03 | 显示全部楼层
去下一个ad9361 HDL reference。里面所有的都是TCL脚本生成的。
发表于 2018-2-5 23:22:13 | 显示全部楼层
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