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查看: 1988|回复: 1

[求助] pll的cpld实现

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发表于 2017-7-17 23:31:28 | 显示全部楼层 |阅读模式

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CPLD可以像fpga一样具有PLL配置不同时钟输出吗？
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发表于 2017-7-18 09:22:49 | 显示全部楼层
用过Lattice的CPLD，是可以的。内部也有PLL
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