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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › DC综合时，有什么命令 可以把clock tie 0 的DFF优化掉 ...
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楼主: 浩然若枫

[求助] DC综合时，有什么命令 可以把clock tie 0 的DFF优化掉

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imadam
发表于 2022-3-11 10:13:48 | 显示全部楼层


xingyun666666 发表于 2022-3-10 10:56
前辈，他的意思是，IP的ck端是否接收clock是通过一些reg来控制的？所以因为IP不用这个clock，那相应的reg ...


不这么设置应该是更保守一些，保证更多path被优化到。也许其他mode就不需要这个case设置。
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ouyuforever
发表于 2022-3-14 10:59:07 | 显示全部楼层
不需要任何设置，能不能优化掉，取决于逻辑是否等价
clk tie 0 不是寄存器被优化掉的充分条件
举个例子，这里如果复位变化，即使clk tie 0 ，Q端仍然可以有变化
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