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qinyu010

发表于 2017-5-2 10:58:25 | 显示全部楼层 |阅读模式

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求同志们帮我指点下： 1. xilinx k7 FPGA平台，soc系统频率设置48M,时序没有问题。略微提升到50M,时序都会报错。是什么原因？（时序报告上面有很多条路径setup 没有满足，但我感觉不至于，应该有别的原因吧？）

2. 固件驱动在fpga上面跑了一下，读写速度较慢，首先，从软件方面考虑，我想具体算出每步的速度，找出影响速度的问题，有什么方法或者参考书籍？

谢谢！也可q469751542@qq.com

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