这个小数分频的仿真结果有问题吗？

自学成菜 · 发表于 2017-3-6 08:25:05

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第一次设计FRACPLL, 有些问题还没有理解透彻，仿真波形如下： $fracpll_sim.JPG$

C2、C1、C0为调制器的输出，送到反馈分频器控制分频比，C高位的没有变化所以没PLOT出来
后面为VCO的频率和VC电压，不知道这样的结果算不算正确？觉得VCO电压变化好像大了点。请做过的雷锋同志指点下，谢谢！

18482100828 · 发表于 2017-3-6 09:40:47

楼主，是用的spectreVerilog仿的吗？

自学成菜 · 发表于 2017-3-6 10:28:02

回复 2# 18482100828

不是，直接SPECTRE仿真的

rong00i8 · 发表于 2017-3-6 21:49:45

Kvco太大

wandola · 发表于 2017-3-7 09:23:13

感觉没什么问题。Vctl的变化非常小.

你应该看得是，把vco输出做psd，看phase noise。那样可以简单的检验有没有锁定，而且能估算出输出的IPN.

另外，建议在电源，地上都加上寄生电感做反正。decap也要加足够的。

hzx85337856 · 发表于 2017-3-7 22:15:30

回复 5# wandola

请教一下IPN是啥呢？

tedwu0508 · 发表于 2017-3-7 23:29:29

It seems your delta sigma or the modulator is not controlled correctly, the output of your modulator change more than one steps!

自学成菜 · 发表于 2017-3-8 14:07:18

回复 7# tedwu0508

你说的不对吧，为什么只能1位变化呢，我看MASH1-1-1结构的都是-3到4之间随机变化啊

tang66521 · 发表于 2017-3-9 09:41:29

有没有问题，对VCO输出做PSD分析才能比较明显的看出来，上面的图只能说功能是对的

xuriver2012 · 发表于 2017-3-9 14:26:56

从VCO的控制电压看，reference spur恐怕不小啊

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