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查看: 2859|回复: 7

[求助] verilog的一维数组赋值问题请教各方豪杰

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发表于 2017-1-6 16:16:41 | 显示全部楼层 |阅读模式

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大家好,请问一位数组是否可以将值赋值给另一个一维数组?如下:

reg [31:0] udp_data [301:0];    //一维数组reg [15:0] angval [23:0];
reg [15:0] distval [23:0];
reg [7:0] intenval [23:0];


always @(*)
begin  
udp_data[0]<= {8'hff,8'hee,angval[0][7:0],angval[0][15:8]};
udp_data[1]<= {distval[0][7:0],distval[0][15:8],intenval[0],8'h00};

......
......
end


请问下这种赋值方式可行吗?
目的就是将angval ,distval ,intenval 三组传感器采集过来的数据,赋值给udp_data 送入RAM通过网口发送给PC,做到实时更新数据。
谢谢!
 楼主| 发表于 2017-1-6 16:38:26 | 显示全部楼层
自己顶
发表于 2017-1-7 08:43:44 | 显示全部楼层
本帖最后由 vigorkylin 于 2017-1-7 08:45 编辑

reg [31:0] udp_data [301:0];
我觉得应该是下面的吧
reg [31:0] udp_data [0:301];
上面那种写法也没问题,能对上号就行。
可以那么赋值
发表于 2017-1-7 09:55:32 | 显示全部楼层
没问题的
发表于 2017-1-7 14:08:33 | 显示全部楼层
应该可以的。
发表于 2017-1-8 12:35:35 | 显示全部楼层
没问题
发表于 2017-1-9 10:49:30 | 显示全部楼层
好好地
 楼主| 发表于 2017-1-20 15:44:32 | 显示全部楼层
多谢楼上几位豪杰,确实没问题~
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