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[求助] psub floating 会导致什么问题呢

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发表于 2016-8-1 09:18:52 | 显示全部楼层 |阅读模式

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请问大家,如果版图中psub真的floating会导致什么问题呢?会导致漏电吗?漏电的原理又是什么呢
发表于 2016-8-1 12:08:48 | 显示全部楼层
看具体位置吧!一般来说P_sub接电位不会仅仅在某一处,所有的P-sub会通过轻掺杂的P-连在一起,只是轻掺杂导致R会比较大。倘若你某一处A没有接:
1、A初处正好是NMOS的sub端,那LVS会有error;
2、A处只是普通的sub ring(,不直接接到device),A处电位会被抬高(假如你的P-sub原本是要接0V)
     1)A附近的NW(或者HVNW)电位Va较高,A电位抬高之后也不会高于Va,这样相对安全,只这个P-subring可能会失去搜集载流子、隔离噪声等作用
     2)A附近的NW(或者HVNW)电位Va较低(比如0V),A处电位抬高后可能会高于Va,那么久会出现寄生diode正偏,也就会漏电,或者latch-up问题。
所以,在layout中应该避免这种不确定电位的东西出现!
个人观点,请参考!
发表于 2016-8-3 11:16:47 | 显示全部楼层
2# 讲的很详细!!
发表于 2016-8-3 20:52:45 | 显示全部楼层
对  二楼讲的很详细!!!
发表于 2016-8-8 21:40:08 | 显示全部楼层
回复 2# Snowy2016

不是轻掺杂处电阻低吗
发表于 2016-8-9 11:34:21 | 显示全部楼层
回复 5# 八月飘雪66

您说反了吧!是重掺杂电阻小
发表于 2016-8-9 19:11:16 | 显示全部楼层
回复 6# Snowy2016


   电阻率的大小决定于半导体载流子浓度n和载流子迁移率μ:ρ=1/ nqμ

我记反了  不好意思
发表于 2018-5-30 12:11:05 | 显示全部楼层
谢谢2楼详细讲解
发表于 2023-9-14 18:01:36 | 显示全部楼层


Snowy2016 发表于 2016-8-1 12:08
看具体位置吧!一般来说P_sub接电位不会仅仅在某一处,所有的P-sub会通过轻掺杂的P-连在一起,只是轻掺杂导 ...


感谢 学到了
发表于 2023-9-14 18:13:29 | 显示全部楼层
P floating万一是高电位,会有可能导致寄生PN结正向导通,导致漏电等等
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