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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › 哪些情况需要设置set_fault_path???
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查看: 3297|回复: 8

[求助] 哪些情况需要设置set_fault_path???

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dyytx
发表于 2016-7-11 23:10:04 | 显示全部楼层 |阅读模式

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哪些情况需要设置set_fault_path???
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Zongxiao
发表于 2016-7-12 14:00:08 | 显示全部楼层
fault ? false ?
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wowwjy
发表于 2016-7-12 16:54:15 | 显示全部楼层
set_false_path吧，当一条path跨越两个不同的clock domain时，或者在逻辑上不可能通过的path，需要设置成false path    后端新手的一点浅见
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dyytx
 楼主| 发表于 2016-7-12 19:48:51 | 显示全部楼层
回复 3# wowwjy

是set_false_path，逻辑上不可能通过是什么意思，谢谢！
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wowwjy
发表于 2016-7-13 09:47:53 | 显示全部楼层
回复 4# dyytx

就是虚假路径，小红书有讲，你可以把讲STA的那章看看，里面举了个例子，同一个sel信号控制两个2选1，一共四条path只有两条是真的，即sel=0和sel=1
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dyytx
 楼主| 发表于 2016-7-13 12:09:10 | 显示全部楼层
回复 5# wowwjy


    小红书指的是哪一本啊？
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杰克淡定
发表于 2016-7-13 19:25:28 | 显示全部楼层
一般是timing违例很离谱的，做流程的人千万不要私自加false path的约束，找设计人员确认是否为false path。除了默认的异步信号之间的false path，其他可能的false path就是工具默认做了检查，但实际设计可以不用关心的时序路径，这类false path并没有所谓的共性特点，它是跟具体逻辑设计相关的。
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萧璇
发表于 2016-7-15 17:58:29 | 显示全部楼层
1.           从逻辑上考虑，与电路正常工作不相关的那些路径，比如测试逻辑，静态或准静态逻辑。
2.          从时序上考虑，我们在综合时不需要分析的那些路径，比如跨越异步时钟域的路径。
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liangyi790328_8
发表于 2016-7-20 11:14:46 | 显示全部楼层
在电路中不需要量timing约束的path， 比如是两个异步时钟之间的path
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