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[求助] 求助一个有关xilinx时序约束的问题

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发表于 2016-4-15 23:34:32 | 显示全部楼层 |阅读模式

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各位好,初学者问一个比较低端的问题,今天看了一些时序约束的知识,不明白用offsets before进行输入约束时这个offset值是怎样算出来的?
发表于 2016-4-29 10:50:20 | 显示全部楼层
回复 1# 风中飞


   这个约束要看你跟什么芯片接
发表于 2016-4-29 15:18:22 | 显示全部楼层
看你接其他芯片的输出延迟在加上时钟频率来确定。比如时钟频率100MHz,其他芯片输出给FPGA的输出延迟为6ns,则FPGA的offset before不得少于4ns。这里假定理想状况,FPGA和外部芯片的时钟同源,且时钟到达FPGA和外部芯片的相位完全相同。
发表于 2016-4-29 15:29:21 | 显示全部楼层
楼上正解。输入输出offset与线长及时钟有关,这个可以和硬件PCB工程师沟通,自然会了解。
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