回复 1# Hwangbo
您好: 我是空军工程大学电子与通信工程专业一名硕士研究生(2016届应届毕业生),很高兴看到贵公司的招聘信息。我这边主要是做通信系统或者说是做软件无线电接收机(GPS/北斗接收机基带信号处理),以及与其相关算法的设计、论证、FPGA实现等。包括调制解调、数字混频(DDC/DUC)、数字滤波、算法实现、以及一些简单的编解码,使用的开发平台是Xilinx ISE Design Suite 14.4(仿真工具:Modelsim10.1a,综合工具:Synplify Pro9.6),MATLAB做辅助开发设计和测试验证。但是目前我在turbo、LDPC码FEC(前向纠错)方面仍无法取得突破。
(对于XilinxFPGA而言)在同一个系统中,VHDL与Verilog可以进行混合编程,可以使用VHDL调用/例化Verilog,也可以使用Verilog调用/例化VHDL。因此VHDL与Verilog对于FPGA设计实现来讲,是统一的。学习任何一门语言即可,只要学得好就行。我个人认为,Verilog与VHDL相比,除了语法简单、代码短小外就没有什么优势了,而vhdl语法就比较严格了,代码显得有些冗长,但是ISE可以自动生成Verilog/VHDL模板,调用/例化非常简单。而且,XilinxFPGA已经嵌入DSP、MicroBlaze、PowerPC、ARM etc,直接在Xilinx ISE Design Suite 14.4或Vivado 2013.4上编写HDL代码即可以调用/使用DSP资源,以及使用其软/硬核处理器资源,进行FPGA/ASIC/SOC的设计实现。lovegiving。 |