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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › 12bit pipeline adc设计问题
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查看: 9599|回复: 7

[求助] 12bit pipeline adc设计问题

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zhanghao301
发表于 2016-1-20 21:38:37 | 显示全部楼层 |阅读模式

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小弟最近仿真12bit 20MSPS的pipeline ADC，在计算采用保持电路参数有如下疑问，期待大神解惑。1. 采用电荷转移式S&H，采样保持电容的要求：δC/C<LSB/2
2. 运放的增益要求（1/βA）<LSB/2
请问，这两个误差会不会叠加，假设都使输出结果减小，那S&H的输出误差会不会接近于LSB/2+LSB/2=1LSB？
那设计参数时是不是应该让δC/C<LSB/4，1/βA<LSB/4，那这两个误差源向一个方向偏差时，S&H的输出误差才会接近LSB/4+LSB/4=LSB/2？
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wjqskym
发表于 2016-1-22 09:02:14 | 显示全部楼层
回复 1# zhanghao301


   共同学习
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zhanghao301
 楼主| 发表于 2016-1-22 09:52:56 | 显示全部楼层
自己顶一下，是不是这个问题太小白了，没人搭理。
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hitice
发表于 2016-1-22 12:24:33 | 显示全部楼层


小弟最近仿真12bit 20MSPS的pipeline ADC，在计算采用保持电路参数有如下疑问，期待大神解惑。1. 采用电荷转 ...
zhanghao301 发表于 2016-1-20 21:38

                               
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   这个spec明显是sar adc的天下
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zhanghao301
 楼主| 发表于 2016-1-23 15:25:45 | 显示全部楼层
回复 4# hitice


   能说得详细点吗？谢谢了。
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zhanghao301
 楼主| 发表于 2016-1-26 16:51:28 | 显示全部楼层
自己再顶，论坛有不少做ADC，都不愿意指教这个小白的问题吗
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uponklp
发表于 2016-1-28 16:06:50 | 显示全部楼层
利用电荷守恒推导下就可以得到，不是简单的相加关系。但是在估算的时候一般考虑最坏情况，进行叠加
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zhanghao301
 楼主| 发表于 2016-2-17 19:02:25 | 显示全部楼层
回复 7# uponklp

能否解释一下，如果不是简单叠加，该如何同时考虑这两个误差呢？谢谢。
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