调用ahdlLib中的comparator~

sweet不想长大 · 发表于 2015-11-23 21:28:55

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调用ahdlLib库中的comparator，单独仿真的时候没有问题，但是将这个理想比较器放入整体电路之后，就报错了。错误如下：ERROR:I0 is an instance of an undefined model ahdlLib_comparator_veriloga。
比价器的参数已经设置过了，那问题会出现在哪里呢？
cadence自带库还需要添加model吗？路径在哪里？

sweet不想长大 · 发表于 2015-11-23 21:30:08

自己又来顶！

lovekeduo · 发表于 2015-11-23 21:33:44

ahdlLib的不用添加model，functional的才要model文件。单独仿真没问题，整体有问题，好奇怪。

sweet不想长大 · 发表于 2015-11-23 21:38:13

回复 3# lovekeduo

是啊，单独调出comparator，再加几个逻辑门仿真，就可以出来波形，但是放入我的整体电路后，就报错了！！

lovekeduo · 发表于 2015-11-23 21:42:40

回复 4# sweet不想长大

那试试funcitional的比较器呢, 这个需要添加model文件allfunc.scs，路劲在functional这个文件下

sweet不想长大 · 发表于 2015-11-23 22:15:20

回复 5# lovekeduo

能不能说具体点儿，我怎么找不到functional这个文件夹

lovekeduo · 发表于 2015-11-23 22:24:07

回复 6# sweet不想长大

在cadence安装目录/tools/dfII/etc/cdslib/artist/functional

sweet不想长大 · 发表于 2015-11-24 09:42:56

回复 7# lovekeduo

找到了，谢谢啦~

typhoon222 · 发表于 2018-5-22 17:05:48

回复 8# sweet不想长大

添加model文件allfunc.scs路径后，仿真就好了么？

room深渊 · 发表于 2020-3-16 10:49:46

sweet不想长大发表于 2015-11-24 09:42
回复 7# lovekeduo

请问一下你这个错误是怎么解决的呢？上面层主说functional库的模型仿真出现未定义错误是要加model，那你这个不是仿真ahdlLib里的模型吗，出现未定义的错误是通过加model还是？

[求助] 调用ahdlLib中的comparator~

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