[求助] 关于top level design的derive pg net的一个问题

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shajingwang

发表于 2015-11-20 21:56:36 | 显示全部楼层 |阅读模式

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在做icc2009lab时，在fp阶段，derive pg nets时，脚本如下：derive_pg_connection -power_net VDD -power_pin VDD -ground_net VSS -ground_pin VSS
derive_pg_connection -power_net VDDO -power_pin VDDO -ground_net VSSO -ground_pin VSSO
derive_pg_connection -power_net VDDQ -power_pin VDDQ -ground_net VSSQ -ground_pin VSSQ

然后guide上提到：
This design has two additional P/G signals that are used in the periphery area: VDDO/VSSO, and VDDQ/VSSQ:

这里说的periphery area是指的 pad的post-driver部分吧

additional, Design

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