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[讨论] ASIC设计静电放电的问题

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发表于 2015-10-30 15:58:05 | 显示全部楼层 |阅读模式

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IC设计生产的环节中,抗静电放电的能力,除了跟工艺相关,还跟哪些因素较为密切?
前端设计有什么小技巧可以提高抗静电能力吗?求大神分享经验
我是小白,发现公司生产的芯片抗静电能力差,想了解一下相关知识
发表于 2015-11-5 11:58:28 | 显示全部楼层
还有是否与准备相应的ESD模块咯。
应用场合对产品ESD性能的要求等。
 楼主| 发表于 2015-11-6 18:11:18 | 显示全部楼层
回复 2# DOONPENG007


    应用自然可以加很多的针对处理,我最关心的是,前端设计是否与此相关,我对后端不是太关心,因为个人不打算往后端走
发表于 2015-11-7 08:25:44 | 显示全部楼层
回复 3# vigorkylin


   楼主,是学生吧?
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