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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › Bootstrap动态性能问题
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查看: 9187|回复: 29

[求助] Bootstrap动态性能问题

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ff1268
发表于 2015-8-27 17:53:35 | 显示全部楼层 |阅读模式

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各位先进好

我在实作10bits SAR ADC使用90nm，
我的性能一直上不去，所以我来测试一下Bootstrap性能
取样率100Mhz 输入频率 1Mhz下 ENOB=13.057  SFDR=83.33dB
但是换成 输入频率 10Mhz下 ENOB=10.45  SFDR=69.82dB
我之后是要做到400Mhz的取样率，但是连100Mhz都做的不是很好...
这样的Bootstrap是不是会导致我的全电路性能不好？
那应该如何改进？

谢谢各位的帮忙了

我Bootstrap 测试使用1024点的FFT

Bootstrap如下图

Bootstrapped Switch

Bootstrapped Switch
动态, 如何

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ff1268
 楼主| 发表于 2015-8-28 14:59:26 | 显示全部楼层
没人可以回答嘛？
我是参考 2014 IEEE "A high performance Bootstrap Switch for low Voltage Switched-Capacitor Circuits"
自己顶
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sc_filter_2014
发表于 2015-8-29 17:13:21 | 显示全部楼层
你的 10bit sar可以达到400M的采样率？是不是有点屌
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ff1268
 楼主| 发表于 2015-8-29 19:19:02 | 显示全部楼层
在IEEE已经有SAR可以做到1G了，所以老板希望速度要好，但现在100M就很难做了...
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vdslafe
发表于 2015-8-29 19:59:27 | 显示全部楼层
回复 4# ff1268


    你确信他们是单通道1GHz  10b SAR?
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sc_filter_2014
发表于 2015-8-29 20:47:34 | 显示全部楼层

标题

回复 4# ff1268
    我看到的都是6bit 做到1g的，或者10bit时间交织
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fightshan
发表于 2015-8-29 20:56:49 | 显示全部楼层
把你的时域仿真特性拿出来看看  你是测试单路的性能吗？换成差分的试试  像电荷注入 时钟馈通这样的共模误差都可以通过差分结构消除大部分
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xuriver2012
发表于 2015-8-31 15:18:58 | 显示全部楼层
你的开关管做的多大？现在的现象是随着输入信号的上升采样结果THD下降，貌似同你的这个开关管本身阻抗的非线性相关。
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ff1268
 楼主| 发表于 2015-8-31 16:55:39 | 显示全部楼层
本帖最后由 ff1268 于 2015-8-31 17:31 编辑

谢谢大大们的回应

我之后也是打算作双通道的sar adc

另外下图示我的时域仿真特性图，100M取样率，10M输入 ，希望能请大大发现问题。

时域仿真特性

时域仿真特性

xuriver2012大，我的开关W/L = 1u/100n m＝12，这样会太大嘛？

再次谢谢各位
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ff1268
 楼主| 发表于 2015-9-1 19:43:05 | 显示全部楼层
继续顶，问题还没解决阿，谢谢各位了
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