IP的dout输出到第一个reg的时序怎么约束

biantaixiazai8 · 发表于 2015-8-10 16:40:32

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现在用一个flash的IP，但ip的lib库里的无dout时序。怎么样确保IP的dout输出到第一个reg的D端的时序不会出现问题？尤其是hold方面，怎么做时序约束

trippa · 发表于 2015-8-10 22:01:32

此时IP就相当于一个Register，只要把时钟定义了就自动约束

biantaixiazai8 · 发表于 2015-8-11 10:30:42

回复 2# trippa
我想如果IP的时序库是准确的，估计应该是。但目前的情况是IP的时序库对输入输出口的时序描述不准确~

trippa · 发表于 2015-8-11 22:58:49

回复 3# biantaixiazai8

这个该问IP team吧

icfbicfb · 发表于 2015-8-12 13:39:25

多加delay cell就行了吧

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