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查看: 2763|回复: 1

[求助] 如何用VerilogA编写激励信号

发表于 2015-7-22 14:17:05 | 显示全部楼层 |阅读模式

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各位大神，请教如何用VerilogA语言编写一个激励信号源，比如一个脉冲信号，谢谢指教！

如何, 信号源

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发表于 2015-7-24 11:07:34 | 显示全部楼层

如果是在cadence环境下，可使用analoglib库里的vpwl设置实现脉冲信号~

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