DC综合的约束是根据什么添加的

灵溪小鱼1211 · 发表于 2015-7-15 10:03:07

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在做综合时的一些约束，虽然知道是什么意思，但不知道应该设为什么值，为什么要这样设。例如set_input_delay，set_output_delay，set_driving_cell等这些，之前都是按照别人的脚本修改的，但还是不知道要按一个什么标准来设置值。请指点迷津！

xwwwjy · 发表于 2015-7-15 16:30:50

同问，帮顶

hungon · 发表于 2015-7-15 16:36:59

请查看DC的student guider，上面有讲

hungon · 发表于 2015-7-15 16:40:13

具体看约束那部分

icfbicfb · 发表于 2015-7-16 10:33:30

设计的约束

wanglijlu123 · 发表于 2015-7-16 16:58:54

感觉这些约束的作用比较小，主要还是在做PR的时候加这些约束的

灵溪小鱼1211 · 发表于 2015-7-22 10:32:02

谢谢。。。感觉在学校里做的话，也就是约束个大概吧，等到真正做项目的时候，应该会有更精确的要求。

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