calibre lvs 中port 不匹配!!

罗蒙 · 发表于 2015-7-12 10:04:01

本帖最后由罗蒙于 2015-7-12 10:47 编辑

calibre lvs 检查中:为什么进行port比对时，source中将IO pad 的电源pin VSSH和VDDH当做了port，而layout中却没有把这两个当做port？应该如何修改？个人认为：source中的 VSSH和VDDH不应该被当做port，怎么才能将source中的这两个port去掉？

tb0403 · 发表于 2015-7-12 16:20:07

从CDL中删除掉？

icfbicfb · 发表于 2015-7-13 10:41:07

cdl里面是global的，自然就是port了，
layout里面没有这2个port label/text ,自然就没有了，

mengchong19 · 发表于 2015-7-13 15:20:02

应该是跟LVS的规则文件里面的设的电源地有关系吧！规则里面肯定是将*VDD* *VSS*设为是你的全局电源地了。

罗蒙 · 发表于 2015-7-13 17:00:09

回复 3# icfbicfb

版主，我在spice文件中把对VSSH和VDDH的global设置，去掉了，为什么在calibre lvs检查后，VDDH和VSSH还是被认为是source的port

icfbicfb · 发表于 2015-7-13 17:35:31

在top的subckt定义里面有么

再说，所有的spice文件都检查了么

罗蒙 · 发表于 2015-7-13 21:57:23

回复 6# icfbicfb

在top的subckt里面，我已经把VDDH和VSSH去掉了！您说的“所有的spice文件都检查了么”，我不是很明白，我只有一个spice文件啊

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