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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › crc 串行实现（Verilog)
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楼主: largedeer

crc 串行实现（Verilog)

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bidrs
发表于 2011-10-4 16:26:42 | 显示全部楼层
有没有分块并行的．．．
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rafox
发表于 2012-3-29 00:15:29 | 显示全部楼层
谢谢分享
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mfsgsb1987
发表于 2012-7-16 17:19:35 | 显示全部楼层
xie xie
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ggouhwpb
发表于 2012-10-8 14:49:27 | 显示全部楼层
zaikanyixiaixa
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jrmjrf
发表于 2012-11-19 23:16:41 | 显示全部楼层
正需要了，非常感谢分享~~
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学晋
发表于 2014-3-30 13:57:06 | 显示全部楼层
看看看看
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ynp6252222
发表于 2015-7-8 22:07:13 | 显示全部楼层
回复 1# largedeer


    yyyyyy
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Doubleagent
发表于 2015-12-28 21:31:34 | 显示全部楼层
感谢楼主分享
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11toper
发表于 2016-4-13 10:05:38 | 显示全部楼层
感谢楼主分享
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紫色的童年
发表于 2016-7-6 13:45:30 | 显示全部楼层
谢谢楼主，参考下。
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