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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证讨论 › VCS后仿遇到Timing violation问题请教
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楼主: raindroper

[求助] VCS后仿遇到Timing violation问题请教

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raindroper
 楼主| 发表于 2015-5-21 15:12:52 | 显示全部楼层
回复 9# qyxu1979


   因为在进入复位、上电、离开复位每个过程都等了50个arm指令周期，而且vcs DUMP的波形特别大，所以严重影响仿真速度。所以，我现在想知道有没有办法下一次仿真的时候，从中间某一（复位之后）时刻开始仿真？    synopsys的人已经好久没见到了，(⊙﹏⊙)b.....
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raindroper
 楼主| 发表于 2015-5-21 15:14:12 | 显示全部楼层
回复 10# icfbicfb


   STA过了
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qyxu1979
发表于 2015-5-21 15:44:59 | 显示全部楼层
复位阶段多少ns？50个指令周期应该也不长呀。vcs波形后仿是比较大

在环境里加延迟，等过了复位阶段再启动环境工作，uvm的话可以放在reset_phase阶段。dump波形可以控制dump波形的时刻，复位阶段不dump波形
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qyxu1979
发表于 2015-5-21 19:21:58 | 显示全部楼层
第1个问题你看看报出错那个文件设置的timescale为多少？
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longyoyo24
发表于 2015-5-23 09:36:51 | 显示全部楼层
好东东啊
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raindroper
 楼主| 发表于 2015-5-28 17:37:05 | 显示全部楼层
回复 14# qyxu1979


   前面说的显示不到ps级的问题解决了，在TB里面加了这样一句：$timefomat(-9, 3, "ns", 10);
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maka
发表于 2019-5-15 09:50:36 | 显示全部楼层
有没有报违规路径出来，试着插BUF看能解决不
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dyt99
发表于 2022-4-4 17:54:36 | 显示全部楼层
你好，楼主，请问问题解决了吗，我也遇到了相同的问题
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