在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
查看: 1820|回复: 3

[求助] 求教怎样防止edi 将clk线布到未指定的层?

[复制链接]
发表于 2015-4-21 15:07:12 | 显示全部楼层 |阅读模式

马上注册,结交更多好友,享用更多功能,让你轻松玩转社区。

您需要 登录 才可以下载或查看,没有账号?注册

x
之前发过相关的贴子,一开始用的是图形界面上的按钮去CTS,clk线布到了未指定的层,后来改用CMD,奏效了一段时间,现在CMD也出现了一样的状况,之前发过一个帖子http://bbs.eetop.cn/thread-482085-1-1.html,问题是一样的。我检查了指定的clk布线层,肯定是没有错的,求大神解救!
发表于 2015-4-21 16:13:41 | 显示全部楼层
ndr  rule create 后, cts .spec 指定一下top bottom layer
 楼主| 发表于 2015-4-21 17:25:39 | 显示全部楼层
回复 2# yiyeyo


   spec文件修改了已经
发表于 2015-4-21 17:52:56 | 显示全部楼层
ndr rule 看过了没? 到sync 端口因为std cell的layer 问题,最后一级会不受这个layer rule limited
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条


小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-11-22 01:44 , Processed in 0.017437 second(s), 10 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表