[求助]Mixed Signal Design Verification这个职位前景怎么样？

WLH_EE_TOP · 发表于 2015-1-23 14:03:37

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本帖最后由 WLH_EE_TOP 于 2015-1-23 14:31 编辑

大家好！
小弟今年小硕毕业，签了一家外企，去做混合信号设计验证，开始的时候，听公司人一讲，觉得这个职位挺好，现在看了好多相关的资料，有点担忧，这个职位的就业面是不是太小了，这个会不会朝系统建模方向发展呢？小弟在学校做模拟及系统建模的…………现在有点犹豫…………

情况如上，问题如下：
（1）本身这个职位大家觉得怎么样？
（2）向系统建模方向发展的可能性大不大？
（3）会相数字验证方向发展不？
（4）大家对验证这个职位，以后会不会在一些非大公司也会出现，就业面问题？

谢谢！

A1985 · 发表于 2015-1-23 15:14:21

是不是模拟spice +简单的数字仿真啊。。

WLH_EE_TOP · 发表于 2015-1-23 16:13:34

回复 2# A1985

可能主要是一些Verilog-AMS的模型加入到数字中，提高仿真速度吧！希望会有一些系统的东西吧！

spauls · 发表于 2017-1-20 19:43:44

book ?

ouyds001 · 发表于 2017-2-12 10:25:37

做过一个16nm DPLL的AMS verification，说点浅薄的见解吧。
AMS电路验证都必须考虑一个问题，如何平衡精度和速度。对于一个DPLL电路，如果spice仿真，大概需要两三天。而这时候电路还需一直在修改，这么长的turnaround时间，如果每个case都这么跑，显然受不了。此时，就两种思路，要不就尽量在模块级验证，但这很难验证一些系统功能，比如PLL lock；要不就对非关键电路降低精度要求。比如，差值计算电路是纯数字电路，直接用RTL，模拟电路部分，先全部用verilog-AMS模型，验证系统spec，之后随着设计的细化，再逐步替换为spice，这是便需要AMS simulation。
AMS verification的工具一般是digital simulator+fast spice simulator。从速度上说，AMS simulation有非常明显的优势，如果前面提到的电路，只需要4小时就可以完成，这样一天可以turnaround两次，如果是中国-美国跨时区合作，可以turnaround 3~4次。大大加速了设计进程。但是速度的代价必然是精度，有些电路精度要求低，比如sram，这时AMS verification的一致性很高。有些电路，包含很多loop，比如DPLL，很多时候AMS仿真并不能得到一个一致性的结果，这时候，你就得需要对电路的精度设置有细粒度的控制，这需要经验和对电路的了解。当仿真失败时，需要和designer一起分析是电路本身原因还是仿真设置的问题，甚至是工具的缺陷。
总的来说，对高速AMS设计来说，AMS verification还是一个很重要的岗位，面对的问题比digital verification更繁杂。也许他没有digital verification那么就业面广，但在市场上找一个有经验的，能处理28nm以下工艺的AMS verification engineer也不容易。不然，我也不会被抓壮丁去干这个了。

protecter · 发表于 2017-2-22 22:00:48

好精细的分析

无敌达达 · 发表于 2017-2-27 08:12:40

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