altera xilinx的疑问

cqm239 · 发表于 2007-4-2 17:19:35

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我编写了一个程序，VERILOG的，在altera中是可以仿真编译的，在xilinx的ISE中就不能编译成功了。

有的是一个计数器类型的，就是没有赋给初值0，是不是在altera中可以不设初值，而在xilinx中是不可以呢。？？？？

lwj625 · 发表于 2007-5-6 23:46:36

应该赋初始值的

adscounter · 发表于 2007-5-12 21:36:09

为什么应该赋呢

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