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查看: 2174|回复: 3

[求助] 对于逻辑太复杂导致的congestion问题,后端如何解决?

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发表于 2014-2-21 10:11:39 | 显示全部楼层 |阅读模式

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如题,由于算法需要,逻辑很复杂, 综合出的 netlist ,寄存器输出端的 fanout endpoint 都很大,即一个寄存器的输出结果要提供给好几千个寄存器使用,中间的组合逻辑 很多是pin脚很多的std cell,如AO222。
这样,在后端阶段看到该模块出现congestion问题,绕线很困难,对于这样的问题, 除了加blockage增加面积外,还有什么方法解决?
发表于 2014-2-21 11:44:50 | 显示全部楼层
http://bbs.eetop.cn/thread-304535-1-1.html
里面的方法可以一试
发表于 2014-2-22 14:35:35 | 显示全部楼层
copy the high fan-out  logic to improve timing, at the expense of chip area.
发表于 2014-2-22 18:21:36 | 显示全部楼层
是走的DCT spg流程?
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