TetraMAX DRC S1 violations 求指点

HOLLYSMOKE · 发表于 2013-12-31 18:13:16

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使用TetraMAX对一个.verilog 设计进行ATPG过程中出现DRC violation (S1)，具体如下：

对其中一个violation 用GSV打开电路图，（自动切换到shift模式），如下：

GSV Violation

之前也遇到过S1类型的violation，基本都是由于复位信号没有设置正确导致的(man S1里也是这么解释的)，比较好修改。但是这个……组合逻辑怎么会block chain啊？

求指点啊。

谢谢啦。

HOLLYSMOKE · 发表于 2013-12-31 20:14:54

走过路过的帮忙看看啊，提点思路呀，谢谢啦

ss3035 · 发表于 2019-1-22 15:49:17

thanks & filling

ss3035 · 发表于 2019-1-22 17:13:08

make money

ss3035 · 发表于 2019-1-22 17:16:18

filling

ss3035 · 发表于 2019-1-22 17:46:20

test only

人生百态 · 发表于 2022-8-10 16:10:44

遇到同样的问题，请问是否解决

losenobody · 发表于 2023-10-28 17:10:44

我的chain也被与非门卡住了,dont know why

voiluce · 发表于 2023-10-30 11:34:43

应该是SI 的path 上插入了一些奇怪的逻辑~~~

鸥鸟忘机 · 发表于 2024-10-12 12:00:41

遇到同样的问题

[求助] TetraMAX DRC S1 violations 求指点