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[求助] 【求大神】由可以实现功能的vhdl改成verilog后不能运行了

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suge168

发表于 2013-12-24 20:59:58 | 显示全部楼层 |阅读模式

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Tetris_1.zip (1.86 MB, 下载次数: 1 ) 小弟，最近几天将一个vhdl编的俄罗斯方块转换成了verilog的形式，，转换过程中遇到了很多问题，一一改正之后，发现终于可以综合了，也可以生成bit文件了，但是，，下载到板子上之后却不能运行！！vhdl的形式可以运行。请问各路大神。这可能是什么问题呢？？附件中传上了代码，板子是赛灵思的basys2，用软件是ISE求大神们指正

vhdl改成verilog

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