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[讨论] 设计的折叠共源共栅vds>vgs-vth却是线性区,vds<vdsat

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发表于 2013-12-17 18:23:56 | 显示全部楼层 |阅读模式

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发表于 2013-12-17 19:43:39 | 显示全部楼层
能不能上传小一点的图片啊!请注意
发表于 2013-12-17 19:45:10 | 显示全部楼层
一个图片4、5M,上传时也能看出来啊!
要知道1920*1080的照片常见的jpg大小也就300k-500k之间
 楼主| 发表于 2013-12-17 20:13:18 | 显示全部楼层
你能解决问题吗?????????
发表于 2013-12-17 23:18:42 | 显示全部楼层
回复 1# Apenper


   vgs-vth is too small
发表于 2013-12-18 09:13:26 | 显示全部楼层
饱和区 vds>vdsat
发表于 2013-12-18 09:30:06 | 显示全部楼层
回复 4# Apenper

请先解决方便多有数人看的问题
发表于 2013-12-18 10:01:09 | 显示全部楼层
问题就两个 1.过驱动电压留的太少
2.W/L设置和Ibias不合理,只要较少的过驱动电压 电路也能工作起来,电路工作在弱开启区
 楼主| 发表于 2013-12-18 18:57:22 | 显示全部楼层
我减小W/L还是出现一样的情况啊,按理来说I不变减小W/L,Vov增大啊,Vov是增大了,但还是始终Vds<Vdsat,或者改变尾电流,增大共源共栅的电流,最后两个管子也是线性区,并且我的增益远远下降
发表于 2013-12-19 04:43:26 | 显示全部楼层
回复 2# semico_ljj


   先帮大家把他的图缩小
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