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查看: 1578|回复: 3

[求助] ATPG PRBLEM WITH tetramax!请教大牛!

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发表于 2013-11-25 11:28:57 | 显示全部楼层 |阅读模式

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芯片开始后要经过两个端口(一个时钟(5MHZ),一个数据(100001000)),使得内部信号hier/y为一号才能进入测试模式,请问
如何在STIL中定义这一行为,从而产生test pattern?
 楼主| 发表于 2013-11-26 09:05:49 | 显示全部楼层
没人回复吗!
发表于 2013-12-7 23:03:41 | 显示全部楼层
可以这样吧,一个周期,一个周期的给,连续给9个周期,同时每个时钟信号为1时,也输入信号为数据的相对应的数值.
 楼主| 发表于 2013-12-11 09:40:30 | 显示全部楼层
多谢,现在setup信号对了,但到shift该信号又是X 了,不解
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