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[求助] SNDR in Current Steering DAC

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发表于 2013-10-8 21:03:03 | 显示全部楼层 |阅读模式

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Hi all ,

Resently I have simulated the SNDR of a 12b Current sterring DAC ,but it is only 54dB, thus the enob is 9bit . Simulation by Cadence without mc model.

So, I'm very confused why the DAC's SNDR was so bad ?

Can anyone give me some help?

By the way, How to tradoff the transistors' size of current source for the Statics and Dynamic performance ?

Best regards!
lvbq
发表于 2013-10-9 11:07:23 | 显示全部楼层
At first you should provide some circuit structure information and simulation results, so we can analysis the issue.
发表于 2013-10-9 11:09:35 | 显示全部楼层
How about the DNL/INL character of your DAC?
发表于 2013-10-9 16:38:36 | 显示全部楼层
没用校准的话,输出阻抗继续加大吧,没别的

电流管L做大点,开关管面积小点,静态的靠DEM,动态的靠开关交越点调整或者dummy开关什么的
 楼主| 发表于 2013-10-9 23:32:41 | 显示全部楼层
回复 4# kwankwaner


   OK,Thanks
 楼主| 发表于 2013-10-9 23:32:46 | 显示全部楼层
回复 4# kwankwaner


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